会员限时优惠
熊帅帅
13800000000
zhangwei@example.com
深圳
30
男
FPGA开发工程师
在职
深圳
20k-30k教育经历
西安电子科技大学
双一流
电子信息工程
本科
2015.092019.06
- 系统学习了电子电路、信号与系统、数字信号处理等专业课程，为FPGA开发奠定了坚实的理论基础。
- 积极参与学校组织的电子设计竞赛等实践活动，锻炼了动手能力和团队协作能力。
工作经历
深圳华芯科技有限公司
行业领先
研发部
FPGA开发工程师
FPGA开发系统调试
2019.072022.06
深圳
- 负责公司FPGA产品的需求分析、方案设计和代码实现，主导完成了多款产品的FPGA核心模块开发，产品上市后市场反馈良好，销售额同比增长20%。
- 与硬件工程师、软件工程师紧密协作，进行系统联调与测试，及时解决FPGA相关的技术问题，确保产品性能稳定，项目交付准时率达100%。
- 持续优化FPGA代码，提高代码的可读性、可维护性和运行效率，平均优化代码执行时间15%以上。
深圳芯动科技有限公司
技术实力强
研发中心
资深FPGA开发工程师
团队管理技术攻坚
2022.07至今
深圳
- 带领团队承接了公司重点项目的FPGA开发任务，制定详细的开发计划和技术路线，成功攻克了高速数据处理、复杂算法实现等技术难题，项目提前1个月交付。
- 负责团队成员的技术指导和培训，提升团队整体技术水平，团队成员在项目中成长迅速，多人获得公司年度优秀员工称号。
- 参与公司FPGA技术预研工作，跟踪行业前沿技术动态，为公司产品规划提供技术支持和建议，推动公司产品技术升级。
项目经历
工业控制高速数据采集处理系统 - FPGA开发工程师
2020.032021.06
深圳华芯科技有限公司
- 该项目为一款工业控制领域的高速数据采集与处理系统，采用FPGA作为核心处理单元。
- 负责FPGA逻辑设计，实现了高速ADC数据采集接口、数据缓存与预处理模块、基于流水线技术的实时数据处理算法等功能。
- 优化FPGA资源利用率，在保证系统性能的前提下，将芯片成本降低10%。
- 与硬件团队协作完成PCB设计与调试，系统测试结果表明，数据采集精度达到±0.5%，处理速度提升30%，满足工业现场复杂环境下的应用需求。
通信基站FPGA基带处理模块 - FPGA开发工程师
2022.102023.08
深圳芯动科技有限公司
- 参与设计的通信基站FPGA基带处理模块项目，旨在提升基站信号处理能力和通信质量。
- 承担信道编码与解码模块的FPGA实现工作，采用并行处理架构，提高编码解码速度，降低误码率。
- 进行模块的时序分析与优化，确保在200MHz时钟频率下稳定运行。
- 配合软件团队完成系统联调，通过大量的仿真和实际测试，验证了模块功能的正确性和稳定性，使基站信号处理时延降低25%，有效提升了通信系统性能。
个人总结
具备[X]年FPGA开发经验，熟悉Verilog/VHDL等硬件描述语言，掌握FPGA开发流程和工具链（如Xilinx Vivado、Altera Quartus等）。 擅长数字信号处理、高速接口设计、算法硬件实现等领域，有多个成功项目经验，能独立承担FPGA核心模块开发任务。 具备良好的团队协作能力和沟通能力，善于解决复杂技术问题，追求技术创新，致力于为公司创造价值。
技能专长
Verilog/VHDL
Xilinx Vivado
Altera Quartus
数字信号处理
高速接口设计
荣誉奖项
公司年度优秀员工
其他信息
硬件描述语言扩展知识:
- 深入研究SystemVerilog等硬件描述语言扩展特性，用于提高FPGA代码的可验证性和可维护性。
- 学习并实践基于UVM（Universal Verification Methodology）的FPGA验证方法学，提升验证效率和质量。
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