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熊帅帅

phone13800000000
emailzhangwei@example.com
city上海
birth32
gender
job高级FPGA开发工程师
job_status在职
intended_city上海
max_salary30k-50k
个人总结

10年FPGA开发经验,精通Verilog/VHDL语言,熟悉多种FPGA开发工具(如Xilinx Vivado、Intel Quartus)。在通信、人工智能、数据中心等领域有丰富项目经验,具备架构设计、算法实现、团队管理能力。善于技术创新,有专利申请经验。具备良好的沟通协作能力,能推动项目高效交付。

教育经历
西安电子科技大学
电子信息特色
电子信息工程
本科
2011.092015.06

在校期间,系统学习了数字电路、模拟电路、FPGA原理与应用等专业课程,掌握了扎实的理论基础。通过参与电子设计竞赛等实践活动,锻炼了实际动手能力和团队协作能力。

工作经历
华为技术有限公司
行业领先
无线产品线
FPGA开发工程师
通信领域算法实现
2015.072019.12
深圳
  • 负责公司某通信设备的FPGA模块开发,采用Verilog语言实现数据处理算法,优化代码结构,使模块运行效率提升30%。
  • 参与项目需求分析,与硬件工程师、软件工程师协作,确保FPGA设计与整体系统架构匹配,成功完成多个项目的交付。
  • 主导FPGA开发流程优化,制定代码规范,培训新入职工程师,提升团队整体开发效率20%。
阿里巴巴达摩院
互联网巨头
芯片研发部
高级FPGA开发工程师
架构设计专利申请
2020.012023.08
上海
  • 带领团队承担某人工智能加速卡的FPGA开发任务,负责架构设计与关键模块开发。采用高性能IP核,使加速卡处理速度达到行业领先水平,项目交付后产品市场占有率提升15%。
  • 优化FPGA资源利用,在保证性能的前提下,将芯片成本降低25%。与供应商紧密合作,解决芯片量产中的技术难题。
  • 推动团队技术创新,申请FPGA相关专利3项,提升公司技术壁垒。组织技术分享会,促进团队技术交流与提升。
项目经历
5G基站FPGA基带处理模块开发
技术负责人
华为技术有限公司
2017.032019.06
  • 项目背景:为满足5G通信低时延、高带宽需求,开发5G基站FPGA基带处理模块。
  • 技术实现:采用Verilog HDL语言,实现OFDM调制解调、信道编码译码等算法。利用FPGA并行处理特性,优化流水线设计,使模块处理时延降低40%,吞吐量提升50%。
  • 项目成果:模块通过严格测试,成功应用于多个5G基站项目,为公司带来5000万元以上收入。
数据中心FPGA高速数据处理系统开发
核心开发工程师
阿里巴巴达摩院
2021.052023.03
  • 项目背景:针对数据中心海量数据处理需求,开发基于FPGA的高速数据处理系统。
  • 技术实现:设计高速接口(如PCIe、SerDes),实现数据的高速采集与传输。采用算法优化与硬件加速相结合,实现数据压缩比提升60%,处理速度达到100Gbps。
  • 项目成果:系统在数据中心部署,节省存储成本30%,提升数据处理效率40%,获得客户高度认可。
技能专长
Verilog HDL
FPGA架构设计
算法硬件实现
Xilinx Vivado
团队管理
荣誉奖项
华为优秀员工(2018年)
阿里巴巴技术创新奖(2022年)
其他信息
专利:
  • 拥有《一种基于FPGA的高速数据压缩方法》等3项发明专利,提升公司技术竞争力。

高级FPGA开发工程师简历模板

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