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熊帅帅
13800000000
zhangwei@example.com
深圳
32
男
资深FPGA开发工程师
在职
深圳
30k-40k教育经历
西安电子科技大学
电子信息特色院校
电子信息工程
本科
2010.092014.06
- 系统学习了数字电路、模拟电路、信号与系统等专业课程，掌握了扎实的理论基础。
- 积极参与电子设计竞赛等实践活动，锻炼了动手能力和团队协作能力。
工作经历
华为技术有限公司
世界500强
无线产品线
FPGA开发工程师
FPGA开发通信设备
2014.072019.12
深圳
- 负责公司通信设备中FPGA模块的设计与开发，采用Verilog语言实现复杂逻辑功能，如高速数据处理、协议解析等。
- 参与项目需求分析和方案设计，与硬件、软件团队紧密协作，确保系统整体性能优化。
- 主导FPGA代码的编写、调试和测试工作，优化代码结构，提高代码的可维护性和可复用性，将代码执行效率提升了20%。
- 解决项目开发过程中的技术难题，如时序收敛、资源优化等，保障项目进度按时完成。
腾讯科技（深圳）有限公司
科技创新企业
人工智能实验室
资深FPGA开发工程师
FPGA架构团队管理
2020.012023.08
深圳
- 带领团队承担公司人工智能芯片中FPGA加速模块的研发任务，制定技术方案和开发计划。
- 负责关键算法的FPGA实现与优化，通过并行计算、流水线设计等技术，使算法处理速度提升30%，满足芯片高性能要求。
- 管理团队成员的工作分配和进度跟踪，组织技术交流和代码评审，提升团队整体技术水平。
- 与芯片设计团队密切合作，参与芯片架构设计和接口定义，确保FPGA模块与芯片其他部分的高效协同。
项目经历
5G基站FPGA基带处理模块开发 - FPGA开发工程师
2016.032018.12
华为技术有限公司
- 项目名称：5G基站FPGA基带处理模块开发
- 项目背景：为满足5G基站高速数据处理和低时延要求，开发基于FPGA的基带处理模块。
- 项目职责：
- 负责模块架构设计，采用并行处理和流水线技术，实现多通道数据的实时处理。
- 编写Verilog代码实现OFDM调制解调、信道编码译码等算法，代码规模达5万行以上。
- 进行时序分析和优化，通过约束文件和布局布线调整，使模块工作频率达到500MHz。
- 与硬件团队协作完成板级调试，解决信号完整性、电源噪声等问题，模块性能达到设计指标。
- 项目成果：模块成功应用于公司5G基站产品，单基站处理能力提升50%，降低了设备成本。
AI推理加速FPGA平台研发 - 资深FPGA开发工程师
2021.052023.06
腾讯科技（深圳）有限公司
- 项目名称：AI推理加速FPGA平台研发
- 项目背景：针对人工智能推理应用，开发基于FPGA的高性能加速平台。
- 项目职责：
- 分析主流AI算法（如CNN、RNN）的计算特点，设计FPGA加速架构，采用数据并行和任务并行策略。
- 实现卷积、池化等算子的FPGA高效计算，优化内存访问模式，减少数据搬移开销。
- 开发平台软件接口，支持Caffe、TensorFlow等框架模型的快速移植。
- 进行平台性能测试和优化，在典型图像识别任务中，推理速度比CPU提升50倍以上。
- 项目成果：平台已在公司内部多个AI产品中应用，提高了产品的实时性和响应速度。
个人总结
10年FPGA开发经验，精通Verilog/VHDL语言，熟悉Xilinx、Altera等主流FPGA平台。 具备丰富的通信、人工智能领域项目经验，擅长复杂算法的FPGA实现与优化。 良好的团队管理和沟通协作能力，带领团队成功完成多个重点项目。 持续关注行业技术动态，不断学习新知识，如异构计算、深度学习加速等，保持技术领先。
技能专长
Verilog
FPGA架构设计
时序分析与优化
通信算法实现
人工智能算法加速
荣誉奖项
华为优秀员工（2017、2018）
腾讯项目创新奖（2022）
其他信息
专利:
- 拥有《一种基于FPGA的高速数据处理方法》等3项发明专利，已授权。
开源项目:
- 参与GitHub上FPGA开源项目，贡献代码1000+行，获得社区认可。
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