PCB Layout主管简历范文全文
自我评价
10年PCB Layout经验，其中4年团队管理经验，主导通信、工控及汽车电子类多层板设计，熟悉高速信号完整性与电源完整性设计规范。熟练使用Cadence Allegro、PADS及Altium Designer，具备20层以上高密度板独立设计能力。曾带领6人Layout团队，将项目平均交付周期缩短25%，一次投板通过率提升至95%以上。
工作经历
深圳市锐联通信技术有限公司
通信设备高新技术企业
深圳
PCB Layout主管
团队管理高速PCB设计
2022年9月 - 至今
- 负责6人Layout团队日常管理与任务分配，制定设计规范与评审流程，项目平均交付周期缩短25%。
- 主导5G基站主板及高速背板Layout设计，完成20层以上高密度板布线，一次投板通过率提升至95%。
- 建立DFM检查清单与器件库标准，与硬件、结构及工厂协同，量产阶段Layout相关不良率下降30%。
东莞华瑞电子科技有限公司
工控电子ODM
东莞
PCB Layout工程师
Allegro多层板布线
2020年7月 - 2022年8月
- 承担工控主板与电源板Layout设计，独立完成4至12层板布线，年均交付项目20余个。
- 配合硬件工程师完成信号完整性与电源完整性仿真优化，关键网络串扰问题减少40%。
- 参与器件封装库建设与设计规范编写，缩短新项目启动周期约15%。
项目经验
车载域控制器高密度PCB设计 - Layout负责人
2024年3月 - 2024年5月
- 负责12层HDI板整体布局布线，统筹阻抗控制与EMC设计，满足车规级可靠性要求。
- 组织3轮设计评审并输出DFM报告，一次投板成功，项目提前2周进入样机验证阶段。
工业电源模块低噪声Layout优化 - PCB Layout工程师
2022年12月 - 2023年2月
- 重构功率回路与地平面布局，优化开关噪声路径，输出纹波降低约35%。
- 配合测试完成整改验证，产品顺利通过CE认证并批量导入生产。
专业技能
Cadence Allegro
PADS
Altium Designer
高速信号完整性设计
电源完整性与EMC
DFM/DFA可制造性设计
多层板与HDI设计
团队管理与项目排期
器件库与设计规范建设
教育背景
广东工业大学
一本省属重点
广州
电子信息工程 本科
2016年8月 - 2020年5月
主修课程：电路分析、模拟电子技术、数字电路、PCB设计基础。
证书与认证
IPC-A-600 印制板可接受性认证 - IPC国际电子工业联接协会
2020年9月
掌握印制板验收标准与质量判定方法。
Altium Certified Associate（ACA） - Altium
2018年6月
证明Altium Designer设计与规范应用能力。
其他信息
到岗时间:
在职，确认录用后一个月内到岗。
出差安排:
可接受短期出差及外派支持工厂。
作品说明:
可提供脱敏后的高速板与HDI板设计案例及叠层方案。
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