数字后端优化工程师简历范文全文
自我评价
5年数字后端优化经验，精通Innovus/ICC2流程与时序收敛，擅长低功耗设计与PPA优化。主导过多颗先进工艺芯片后端实现，频率提升8%以上，面积缩减5%。具备完整签核与量产经验。
工作经历
上海芯启微电子有限公司
集成电路设计先进工艺
上海
数字后端优化工程师
Innovus时序收敛
2022年9月 - 至今
- 负责12nm SoC芯片后端实现，优化时钟树与布线，频率提升8%，面积缩减5%。
- 主导低功耗设计流程，动态功耗降低12%，静态功耗降低18%。
- 完成时序签核与物理验证，芯片一次流片成功，良率提升至98%。
上海华力微电子有限公司
晶圆代工成熟工艺
上海
后端设计工程师
ICC2物理验证
2020年7月 - 2022年8月
- 参与28nm芯片后端布局布线，优化电源规划，IR Drop改善15%。
- 完成时序修复与DRC清理，交付周期缩短10%，确保项目按时流片。
- 编写自动化脚本，提升团队工作效率20%。
项目经验
高性能AI加速器后端实现 - 后端负责人
2024年3月 - 2024年5月
- 负责7nm AI加速器芯片后端全流程，优化布局与时钟树，频率提升10%。
- 采用多电源域低功耗设计，功耗降低15%，面积缩减6%。
- 协调团队完成签核，芯片一次流片成功，性能达标。
教育背景
同济大学
985211
上海
微电子学与固体电子学 硕士
2019年8月 - 2021年5月
研究方向：数字集成电路后端设计。
专业技能
Innovus
ICC2
时序收敛
低功耗设计
物理验证
Tcl/Perl脚本
证书与认证
集成电路后端设计工程师 - 中国半导体行业协会
2021年6月
证明数字后端设计专业能力。
Cadence Innovus认证工程师 - Cadence
2020年12月
证明Innovus工具熟练度。
荣誉奖项
公司年度优秀员工
全国大学生集成电路设计大赛二等奖
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