物联网信号完整性工程师简历范文全文
自我评价
5年物联网硬件与信号完整性工程经验，专注高速数字链路、射频与天线协同设计，熟悉PCIe、USB、MIPI、LPDDR等接口的仿真与测试闭环。主导多个无线模组与智能终端项目的SI/PI整改，量产直通率提升至98%以上。具备从原理图评审、叠层与布线约束到实验室验证的完整落地能力。
工作经历
深圳市联智物联网科技有限公司
物联网模组国家级高新技术企业
深圳
信号完整性工程师
信号完整性高速数字设计
2022年9月 - 至今
- 负责Wi-Fi 6/蓝牙模组与主控板的高速链路SI/PI仿真与整改，完成12款产品签核，一次投板成功率提升至85%。
- 建立叠层、阻抗与布线约束规范，将硬件评审返工次数由每项目5次降至2次，缩短开发周期约3周。
- 主导EMI与射频共存问题定位，配合实验室完成CE/FCC认证，认证一次通过率达95%。
东莞华芯电子科技有限公司
消费电子ODM制造
东莞
硬件工程师（信号完整性方向）
DDR仿真硬件测试
2020年7月 - 2022年8月
- 承担智能穿戴主板DDR与MIPI链路仿真，优化走线与端接方案，眼图裕量提升30%。
- 搭建SI测试流程与治具，累计完成200余次链路测试，问题定位周期由3天缩短至1天。
项目经验
Wi-Fi 6物联网网关高速链路优化 - 信号完整性负责人
2023年3月 - 2023年11月
- 针对PCIe与千兆以太网链路进行通道仿真与阻抗优化，插损降低18%，满足协议裕量要求。
- 联合Layout团队重构关键区域叠层与参考平面，量产阶段链路相关不良率由1.2%降至0.3%。
低功耗蓝牙模组射频与SI协同设计 - 硬件工程师
2021年5月 - 2021年12月
- 完成天线净空与地平面优化，射频输出功率一致性提升，通信距离稳定达到80米。
- 通过电源完整性与去耦方案整改，模组待机功耗降低12%，助力产品通过客户验收。
教育背景
华南理工大学
985211双一流
广州
电子信息工程 本科
2015年9月 - 2019年6月
主修课程：信号与系统、电磁场与电磁波、高速电路设计；CET-6。
专业技能
高速链路SI/PI仿真（HyperLynx、ADS）
阻抗控制与叠层设计
示波器/TDR/网分测试与问题定位
PCIe/USB/MIPI/LPDDR接口规范
射频与天线协同调试
Cadence Allegro与约束管理
证书与认证
信号完整性工程师认证（SI） - 中国电子学会
2023年6月
覆盖高速链路建模、仿真与测试方法。
全国计算机等级考试三级（网络技术） - 教育部教育考试院
2018年9月
证明网络与系统基础能力。
工作成果
量产良率提升
通过SI规范落地，使负责产品线链路相关不良率下降约70%。
公司技术标兵
2023年获评公司年度技术标兵，主导的仿真流程被推广至三个产品线。
其他信息
到岗时间:
在职，确认录用后一个月内到岗。
出差意愿:
可接受短期出差与实验室驻场支持。
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